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電子工程網(wǎng)
標題:
求助各位大俠：VerilogHDL程序出了點錯誤
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作者:
saralover
時間:
2010-11-17 16:39
標題:
求助各位大俠：VerilogHDL程序出了點錯誤
我是新手 剛學VerilogHDL不久，編程的時候遇到了一點問題，求助各位大俠
reg [22:0] sum,sum1,sum2;
.....
if(sum1>sum2) begin sum<=sum1-sum2; p<=1; end
else begin sum<=sum2-sum1; p<=0; end
.........
編譯綜合結(jié)束后，sum只有10位了，請問這是為什么？？？
作者:
xyj
時間:
2010-11-21 09:15
友情幫頂。。。
作者:
penpen
時間:
2011-10-13 20:26
幫挺起
作者:
月落無痕
時間:
2011-10-14 19:02
幫頂起
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