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標題: NXP i.MX8M Mini開發板(4核 ARM Cortex-A53)軟硬件規格說明書(下) [打印本頁]
作者: Tronlong-- 時間: 2024-7-9 12:55
標題: NXP i.MX8M Mini開發板(4核 ARM Cortex-A53)軟硬件規格說明書(下)
圖 31
Watchdog接口
U15為外部硬件看門狗芯片,通過2.54mm間距排針引腳引出3pin配置引腳(J2),可通過跳線帽控制Watchdog的使能。
圖 32
圖 33
USB接口
CON8是USB 2.0 HOST接口,采用單層Type-A型連接器,CON9為USB 2.0 OTG接口,采用Micro USB連接器。
USB 2.0 HOST接口(USB2 HOST)
評估底板通過USB HUB芯片將USB2總線拓展為4路USB HOST總線,其中引出一路到USB 2.0 HOST接口。
圖 34
圖 35
USB 2.0 OTG接口(USB1 OTG)
USB 2.0 OTG接口由USB1總線引出。
圖 36
圖 37
設計注意事項:
F22/USB1_VBUS/Z引腳電平范圍為0~3.3V,由于核心板內部已串接30K電阻,底板設計時請參考評估底板通過串接1K電阻接至5V。
MIPI CAMERA接口
J4是MIPI CAMERA接口,采用30pin FFC連接器,間距0.5mm。
圖 38
圖 39
Ethernet接口
評估板包含1個USB2 ETH百兆網口和1個RGMII ETH千兆網口。
RGMII ETH千兆網口
i.MX 8M Mini內部集成1個GMAC控制器,僅支持1路RGMII千兆網口。CON13為RGMII ETH千兆網口,RJ45連接器已內置隔離變壓器。
圖 40
圖 41
設計注意事項:
RGMII總線與收發器之間需串聯22R電阻。
模擬電源與數字電源通過磁珠隔離。1.2V電源方案需滿足500mA供電要求,且不能用于其他負載供電。
XI、XO引腳接入25MHz無源晶振。為便于晶振起振,XI、XO之間可增加并聯1MΩ電阻。如需使用25MHz有源晶振,可從XI引腳接入,XO引腳懸空處理。
KSZ9031RNXIA芯片要求在供電穩定后,保持10ms后再拉高復位信號。推薦參考評估底板的復位電路方案。
USB2 ETH百兆網口
CON12為USB2 ETH百兆網口,采用RJ45連接器,已內置隔離變壓器。
評估底板通過USB HUB芯片將USB2總線拓展為4路USB HOST總線,使用LAN9500AI芯片將其中一路擴展為USB2 ETH百兆網口。
圖 42
圖 43
設計注意事項:
XI、XO引腳接入25MHz無源晶振。為便于晶振起振,可將貼上R160電阻。如需使用25MHz有源晶振,可從XI引腳接入,XO引腳懸空處理。
MIPI顯示接口
J3為MIPI顯示屏接口,采用40pin FFC連接器,間距0.5mm。
J9為MIPI顯示屏的電容觸摸接口,采用6pin FFC連接器,間距0.5mm。
圖 45
LVDS顯示接口
CON17為MIPI-DSI通過外擴芯片引出的單路8bit LVDS顯示接口,采用30pin雙排針,間距2.0mm,包含LVDS信號及供電電源。CON18為背光控制接口,采用6pin排針端子,間距2.54mm。J7為電阻觸摸屏接口,采用4pin排針,間距2.54mm。
圖 46
圖 47
設計注意事項:
如需實現雙路8bit LVDS顯示,可將SN65DSI83(U41)替換為同系列pin to pin兼容的SN65DSI84,同時需修改軟件驅動。
HDMI OUT接口
CON20為MIPI-DSI通過外擴芯片引出HDMI OUT視頻輸出接口,支持1080P高清視頻輸出。
圖 48
圖 49
設計注意事項:
SPI FLASH
評估底板板載1個SPI FLASH(U14)芯片,容量為8MByte。
圖 50
圖 51
4G模塊拓展接口
評估底板通過USB HUB芯片將USB2總線拓展為4路USB HOST總線,其中引出一路進行4G模塊拓展。4G模塊拓展接口(CON11)采用Mini PCIe插槽座。
CON10為Micro SIM卡座,采用插卡自彈形式,不帶檢測引腳。
圖 52
圖 53
設計注意事項:
WIFI模塊
評估底板通過USB HUB芯片將USB2總線拓展為4路USB HOST總線,其中引出一路進行WIFI模塊拓展。板載的WIFI模塊(U23)采用郵票孔連接方式。
CON19為SMA接口,用于外接2.4G天線。
圖 54
圖 55
Audio接口
CON14為LINE IN音頻輸入接口,CON15為LINE OUT音頻輸出接口,均采用3.5mm音頻插座。
圖 56
圖 57
設計注意事項:
AUDIO接口默認使用CPU內部時鐘,如需使用外部時鐘源,可將R191電阻空貼,貼上R190電阻。
PCIe SLOT接口
CON21為PCIe Gen2接口,采用x4插槽連接方式。單通道鏈路,最高通信速率5Gbps,默認作為RC(Root Complex)模式使用。
圖 58
圖 59
設計注意事項:
使用外部25MHz有源晶振輸入時鐘到CDCM61002芯片的XIN引腳,有源晶振的CE引腳需上拉10K電阻到VDDA_3V3_CLK,使能晶振時鐘輸出。
CDCM61002芯片倍頻輸出2路100MHz差分時鐘PCIE_REF_PAD_CLK和PCIE_REF_CLK。PCIE_REF_PAD_CLK作為i.MX 8M Mini參考時鐘使用;PCIE_REF_CLK輸出到PCle接口作為EP設備同源參考時鐘,請在PCle接口處放置100nF的AC耦合電容。
PCIE_TXN0/TXP0走線需靠近100nF的AC耦合電容。
FAN供電接口
J8為散熱器風扇電源(FAN)接口,采用3pin排針端子方式,12V供電,間距2.54mm。
圖 60
圖 61
設計注意事項:
風扇電路及風扇接口不支持調速功能,不建議使用PWM模式控制風扇開關電路。
拓展IO信號接口
J5通過IDC3簡易牛角座引出FlexSPI、SAI、CLOCK、GPIO等拓展信號,2x 25pin規格,間距2.54mm。
圖 62
圖 63
J6通過排針引出PDM、I2C、UART、GPIO等拓展信號,2x 20pin規格,間距2.54mm。
圖 64
圖 65
設計注意事項:
由于J5擴展接口與BOOT_CFG存在IO復用的情況,如需使用請注意功能之間的相互影響,詳情可查閱“BOOT SET啟動選擇撥碼開關”章節說明。
作者: vhyu 時間: 2025-5-22 14:51
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