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夏宇聞 復(fù)雜數(shù)字電路與系統(tǒng)的VerilogHDL設(shè)計(jì)技術(shù)

發(fā)布時(shí)間：2010-8-2 09:58    發(fā)布者：techieboy
hyghyg 發(fā)表于 2011-6-18 01:22:42
看看再說(shuō)呵呵，做個(gè)就得多看多練
H_Z 發(fā)表于 2011-8-5 16:22:45
老夏的東西 值得看啊
H_Z 發(fā)表于 2011-8-5 16:23:04
收了
H_Z 發(fā)表于 2011-8-5 16:23:32
呵呵
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