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Altera推出Quartus II 12.1版 借助強大的高級設計流程加速系統開發

發布時間:2012-11-20 11:25    發布者:eechina
關鍵詞: Quartus
Altera高級設計流程中增加了Altera面向OpenCL的軟件開發套件(SDK),增強了設計人員的效能,提高系統性能

Altera公司推出Quartus II軟件12.1版——在CPLD、FPGA、SoC FPGA和HardCopy ASIC設計方面,性能和效能在業界首屈一指的設計套裝軟件。這一最新版軟件進一步簡化傳統的硬件開發任務,增強了Quartus II軟件的高級設計環境,因此,用戶提高了效能,同時全面受益于Altera器件的各種前沿功能。Quartus II軟件12.1版含有面向OpenCL的SDK,增強了對高級設計流程的支持,而且還增強Qsys系統集成工具以及基于DSP Builder模型的設計環境。這一最新版軟件包括多種增強特性,例如部分重新配置設計流程,新的知識產權(IP)內核等,還擴展了對28 nm FPGA和SoC FPGA的支持。這些增強特性進一步支持客戶使用Altera器件快速進行設計開發,推出的產品迅速面市。

采用高級設計工具加速系統開發

Altera提供的高級設計工具包括系統級基于C、基于IP以及基于模型的設計輸入系統。這些工具支持并簡化了當今高級可編程系統的開發,這包括,CPU內核、數字信號處理(DSP)模塊以及多個IP子系統。增加了面向OpenCL的SDK,熟悉C語言的系統開發人員和編程人員能夠使用開放高級編程語言,迅速方便的開發高性能、高功效、基于FPGA的應用。面向OpenCL的SDK減小了硬件設計的復雜度,支持熟悉C語言的軟件編程人員面向FPGA進行開發。

對于Altera Qsys系統集成工具和DSP Builder工具的提升,進一步增強用戶的設計效能,提高系統性能。Qsys功能進行了擴展,支持業界標準ARM AXI3和AXI4協議,DSP Builder現在擴展支持7種不同的浮點精度,包括,IEEE 754半精度、單精度和雙精度。最新版Quartus II軟件進一步簡化系統設計,包括支持高速芯片至芯片數據包傳送的100G Interlaken IP內核,以及支持視頻處理應用的視頻蹤跡監視IP新內核。

Altera的DSP和IP市場軟件總監Alex Grbic評論說:“通過硅片融合,FPGA集成了越來越多的功能,Altera開發工具支持OpenCL等更高層的設計抽象,極大的增強了設計人員的效能。Altera一直積極為客戶交付業界領先的開發工具和IP,幫助他們以最快的方式將構思在系統中實現!

Quartus II軟件12.1版包含了首次發布的Altera面向Stratix V FPGA新的部分重新配置設計流程。通過重新配置功能,在FPGA設計其他部分還在運行時,能夠靈活的隨時改變器件的內核功能。設計人員將不同的功能存儲在外部存儲器中,需要時將其裝入到FPGA中,使得客戶能夠在系統中使用更小的FPGA,節省了電路板面積,降低功耗。

12.1版Quartus II軟件還含有多種增強功能,包括對新器件的支持。這一版本軟件支持新的28 nm Stratix V、Arria V以及Cyclone V FPGA和SoC FPGA,包括,對Arria V GZ FPGA的全面支持。關于這一新版軟件的所有新特性,請訪問http://www.altera.com.cn/product ... -qts-whats-new.html

價格和供貨信息

現在可以下載訂購版和免費網絡版的Quartus II軟件12.1版。Altera的軟件訂購程序將軟件產品和維持費用合并在一個年度訂購支付中,簡化了獲取Altera設計軟件的過程。Quartus II軟件訂戶可以收到ModelSim-Altera入門版軟件,以及IP基本套裝的全部許可,它包括15個Altera最流行的IP (DSP和存儲器) 內核。一個節點鎖定的PC許可年度軟件訂購價格為2,995美元,可以通過Altera eStore購買。請聯系您當地的Altera銷售代表,目前通過早期使用計劃向客戶提供面向OpenCL的SDK。


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