請教.cadence創建元件庫和畫原理圖時遇到的問題(已解決)

changyongid

大家好,我在用cadence建立元件庫,畫cpu的時候遇到了一個問題..
如圖....是在畫cpu的第三部分時出現的..



那幾個引腳的名字都相同...不知道這個時候該怎么處理.


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解決:如二樓riverpeak版主所說,這里是命名沖突了....可以定義成不同的名字...
另,用capture cis的話電源地腳可以同名，但要設置為POWER屬性.這里我把它們的屬性都設置為power,就沒有出現報警錯誤了...

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問題:
在放置網絡標號的時候..分為單頁面標號和多頁面標號是吧??
那我們在開始畫原理圖的時候,不知道以后這個連接點的標號是在同一個頁面還是不同頁面,這個時候怎么辦?


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先放單頁的最后提示你哪些和下頁沒有鏈接的信號，你再放連頁的.
比如這里cpu與rom ram的引腳鏈接較多,可以把它們畫在一個頁面里,這樣就可以不放跨頁的標號了.
注:總線要放置port
(其實這一點我還沒有完全弄懂,因為現在還沒有一個全面的認識,等原理圖畫到后面,遇到問題來再理解一下)

這些個問題和答案放在這里記錄一下,也許我認識的不全面,貼在這里給像我一樣初畫原理圖的人一個借鑒.

changyongid

另外,引腳的類型該如何確定呀???如下圖..畫圖的時候該如何選擇呀???


具體畫不同引腳的時候該怎么選?

riverpeak

很明顯你同樣的管腳定義成了一個信號名的，你定義成VDDMOP1 VDDMOP2這樣就不會有報警了。
第二個問題，管腳的類型，我給解釋一下上面的圖依次是三態門，雙向信號，輸入，開路集電極，開路發射極，輸出，無源端，電源
不知道你對上面這些信號端的定義是否了解。

anfaye

老師,定義管教類型是不是只有仿真的時候有用?
如果我不需要仿真的話,是不是管教類型可以隨便選?

riverpeak

沒錯，這些邏輯在仿真的時候有用，如果只是PCB設計的話沒必要定義這么全，不過話說回來，做一次就做好唄

fenghaili

跟著學習……

anfaye

我還有個問題,哈哈,老師們不要嫌煩哦!
就是如果在創建allegro裡面元件封裝的話,我怎么確定零件每個pad,間距,大小什麼的.
因為我看人家話,都直接命令輸入坐標什麼的,比如x 0 1.27之類的?
那個要怎么算啊,如果不用命令輸入坐標,是不是會不準啊

changyongid

沒錯，這些邏輯在仿真的時候有用，如果只是PCB設計的話沒必要定義這么全，不過話說回來，做一次就做好唄
riverpeak 發表于 2009-8-4 23:18

呃...

許多引腳我都不知道怎么去設置他的屬性...不知道這個設置要參考些什么呢?
能否拿幾個引腳舉例說明下???

謝謝回復

anfaye

我的理解是電源pin,比如GND,5V,3V什麼VCCpin,設置為power.
如果該pin在你的電路中是輸入信號的引腳,那么你要把這個腳設置為input
輸出信號就設置為output,總的來說就是根據你那個pin的電器屬性或者說在電路中的作用決定的.
但是前提條件是,在你需要仿真調試pcb板的情況下,如果不用仿真的話,完全不用太細究那個東東

不知道我說的對唄,各位老師,前輩指正指正哈

riverpeak

關于原理圖中管腳的類型，上面回答了一些，具體分為：三態門，雙向信號，輸入，開路集電極，開路發射極，輸出，無源端，電源
比如一個最簡單的二輸入與非門74LS00， 一個門電路起碼有2個輸入一個輸出，還有電源地，那么定義的時候就是input output, power了，VCC和GND都輸入POWER類型的，還有別的與非門有使能端就是輸入啦

f.luo

學習……

lingshiying

推薦兄弟去看看于博士的教程，里面都有說到！

lele

名稱重復這個警告 沒什么影響吧？

gnmxd

看看

shalione

xukuan1989

liurenyin

學習！

hzpj01

guokeqin

學習中！�。。。。。。。�