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AMD:CPU發展頻率為上 核心數競爭不會持久

發布時間:2010-10-22 10:16    發布者:嵌入式公社
關鍵詞: 多核
芯片廠當前無不追求芯片核心數,然超威(AMD)服務器業務技術長DonaldNewell接受IDG專訪時表示,處理器高速運算能力方為芯片競爭勝負關鍵,處理器核心數競賽不會持久。

Newell指出,技術上要發展128多核心處理器并非不可行,然因服務器搭載多核心處理器將耗能過巨,未來技術發展終將轉變,對當前埋首撰寫平行程序,以搭配多核心處理器的開發人員不啻為佳音1則。

早期處理器改善多以頻率作為標準,代代處理器問世,無不是為提升處理器頻率,Newell表示,早年效勞英特爾(Intel)時,亦堅信團隊將能打造出頻率高達10GHz的芯片,直至處理器過熱隱憂計劃方停歇。

然鑒于微顯影技術不斷精進,摩爾定律持續走紅,芯片廠可于芯片上封裝的晶體管數不斷增加,各廠方轉向單一芯片多核心競爭,服務器、桌面計算機(DT)原僅搭載雙核心處理器,不久遂升級至4核心,當前英特爾與超威陣營,又已見6核心與8核心產品。

然Newell認為核心數競賽不久將熄火,異質性處理器運算方為未來戰火熱點,系統單芯片(SoC)內的芯片各司其職,各自處理影像、網絡、編碼等各項功能,將成為時勢所趨。超威擬于2011年推出的加速處理器(AcceleratedPro!cessorUnits;APU)Brazos平臺,可應用于Netbook、筆記本電腦(NB),便是將中央處理器(CPU)與繪圖處??GPU)整合在單1芯片上。

即便英特爾近期揭露80核心處理器細節,令人玩味,然該公司亦是向系統單芯片看齊,近來英特爾大書特書的次世代SandyBridge架構,亦是整合CPU與GPU功能。

Newell表示,若從技術發展路徑看來,最終處理器可能走上部分可重組式架構,以現場可編程邏輯門陣列(FieldProgrammableGateArray;FPGA)做為基礎。

來源:DigiTimes
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