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基于FPGA的VGA顯示矩形框_VGA接口設(shè)計(jì)_VGA信號處理_明德?lián)P資料

發(fā)布時間：2017-8-2 16:30    發(fā)布者：mdykj33
工程說明
本工程VGA顯示要求：在顯示屏邊緣上顯示一個紅色邊框（邊框?qū)挒?0像素），在屏幕的中央顯示一個綠色矩形（矩形長為150像素，高為100像素）。
案例補(bǔ)充說明
本設(shè)計(jì)的VGA圖像顯示是基于FPGA實(shí)現(xiàn)的，采用了Verilog HDL語言編寫，再加上有明德?lián)P的至簡設(shè)計(jì)法作為技術(shù)支撐，可使程序代碼簡潔且執(zhí)行效率高。

代碼文檔說明
至簡設(shè)計(jì)法--VGA_顯示動畫.rar (302.95 KB)


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