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基于FPGA的verilog萬年歷程序_萬年歷設(shè)計(jì)_明德?lián)P資料

發(fā)布時(shí)間：2017-8-2 17:11 發(fā)布者：mdykj33

關(guān)鍵詞： verilog萬年歷 , 萬年歷程序 , fpga萬年歷 , 萬年歷

工程說明

在FPGA設(shè)計(jì)中，數(shù)字萬年歷屬于小規(guī)模集成電路。從原理上來講，是典型的數(shù)字電路，包括組合邏輯電路和時(shí)序電路。基于FPGA開發(fā)除設(shè)計(jì)簡便、開發(fā)成本低、電路簡潔等，更具備功能設(shè)計(jì)靈活方面的優(yōu)勢(shì)。

案例補(bǔ)充說明

萬年歷是記錄一定時(shí)間范圍內(nèi)的年歷，其名稱只是一種象征，表示時(shí)間跨度大。由于其功能非常常用，且極為方便人們查詢使用，因此廣泛應(yīng)用于鐘表、歷書出版物、電子產(chǎn)品、電腦軟件和手機(jī)應(yīng)用等行業(yè)中。

代碼文檔說明

至簡設(shè)計(jì)法--萬年歷.rar (56.45 KB)

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