FPGA與CPLD的對(duì)比

jiemicity

FPGA和CPLD都是可編程ＡＳＩＣ器件,有很多共同特點(diǎn),由于CPLD和FPGA結(jié)構(gòu)上的差異，也具有各自的特點(diǎn)：

一是CPLD更適合完成各種算法和組合邏輯,ＦＰ ＧＡ更適合于完成時(shí)序邏輯。換句話說(shuō),FPGA更適合于觸發(fā)器豐富的結(jié)構(gòu),而CPLD更適合于觸發(fā)器有限而乘積項(xiàng)豐富的結(jié)構(gòu)。
　　
二是CPLD的連續(xù)式布線結(jié)構(gòu)決定了它的時(shí)序延遲是均勻的和可預(yù)測(cè)的,而FPGA的分段式布線結(jié)構(gòu)決定了其延遲的不可預(yù)測(cè)性。
　　
三是在編程上FPGA比CPLD具有更大的靈活性。CPLD通過(guò)修改具有固定內(nèi)連電路的邏輯功能來(lái)編程，F(xiàn)PGA主要通過(guò)改變內(nèi)部連線的布線來(lái)編程;ＦＰ ＧＡ可在邏輯門下編程，而CPLD是在邏輯塊下編程。
　　
四是FPGA的集成度比CPLD，具有更復(fù)雜的布線結(jié)構(gòu)和邏輯實(shí)現(xiàn)。
　　
五是CPLD比FPGA使用起來(lái)更方便。CPLD的編程采用Ｅ2ＰＲＯＭ或ＦＡＳＴＦＬＡＳＨ技術(shù),無(wú)需外部存儲(chǔ)器芯片,使用簡(jiǎn)單。而FPGA的編程信息需存放在外部存儲(chǔ)器上,使用方法復(fù)雜。
　　
六是ＰＬＤ的速度比FPGA快,并且具有較大的時(shí)間可預(yù)測(cè)性。這是由于FPGA是門級(jí)編程,并且ＣＬＢ之間采用分布式互聯(lián)，而CPLD是邏輯塊級(jí)編程,并且其邏輯塊之間的互聯(lián)是集總式的。
　　
七是在編程方式上，CPLD主要是基于Ｅ2ＰＲＯＭ或ＦＬＡＳＨ存儲(chǔ)器編程,編程次數(shù)可達(dá)1萬(wàn)次,優(yōu)點(diǎn)是系統(tǒng)斷電時(shí)編程信息也不丟失。CPLD又可分為在編程器上編程和在系統(tǒng)編程兩類。FPGA大部分是基于ＳＲＡＭ編程,編程信息在系統(tǒng)斷電時(shí)丟失,每次上電時(shí),需從器件外部將編程數(shù)據(jù)重新寫入ＳＲＡＭ中。其優(yōu)點(diǎn)是可以編程任意次,可在工作中快速編程,從而實(shí)現(xiàn)板級(jí)和系統(tǒng)級(jí)的動(dòng)態(tài)配置。
　　
八是CPLD保密性好,FPGA保密性差。
　　
九是一般情況下，CPLD的功耗要比FPGA大,且集成度越高越明顯.

bijinyi

不錯(cuò)。謝謝分享 。