集成電路設(shè)計(jì)制造中EDA工具實(shí)用教程

發(fā)布時(shí)間：2012-7-30 14:36 發(fā)布者：看門狗

關(guān)鍵詞： EDA

書名: 集成電路設(shè)計(jì)制造中EDA工具實(shí)用教程
　　作　者：韓雁
　　出版社：浙江大學(xué)出版社
　　出版時(shí)間： 2007年08月
　　ISBN: 9787308054850
　　開本： 16開
　　定價(jià): 48.00 元

內(nèi)容簡(jiǎn)介

《集成電路設(shè)計(jì)制造中EDA工具實(shí)用教程》共17章，分為三個(gè)部分。第一部分介紹半導(dǎo)體工藝和半導(dǎo)體器件仿真工具，分別介紹了Synopsys公司的TSUPREM4/MEDICI，ISE TCAD和Silvaco公司的Athena/Atlas等TCAD工具及其使用，并以ESD靜電放電防護(hù)器件的設(shè)計(jì)及驗(yàn)證為實(shí)例介紹這些軟件工具的應(yīng)用。第二部分介紹了模擬集成電路設(shè)計(jì)工具的應(yīng)用，輔以典型模擬IC電路的設(shè)計(jì)實(shí)例，以Cadence設(shè)計(jì)流程中的工具為主，同時(shí)也介紹了業(yè)界常用的Synopsys的Hspice電路仿真工具和Mentor Graphics的Calibre版圖驗(yàn)證工具。第三部分為數(shù)字集成電路的設(shè)計(jì)工具使用教程，分別介紹了用Matlab進(jìn)行系統(tǒng)級(jí)驗(yàn)證、用ModelSim和NC-Verilog進(jìn)行HDL描述和仿真、用Xilinx ISE進(jìn)行EPGA驗(yàn)證設(shè)計(jì)、用Synopsys的Design Compiler工具進(jìn)行邏輯綜合以及使用Cadence的SE和SOC Encounter進(jìn)行IC后端設(shè)計(jì)等。最后介紹了可測(cè)性設(shè)計(jì)的基本概念和流程。

集成電路設(shè)計(jì)制造中EDA工具實(shí)用教程.pdf (11.63 MB)

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